lib/librte_eal/common/include/arch/arm/rte_atomic_32.h

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  29  *   (INCLUDING NEGLIGENCE OR OTHERWISE) ARISING IN ANY WAY OUT OF THE USE
  30  *   OF THIS SOFTWARE, EVEN IF ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.
  31  */
  32
  33 #ifndef _RTE_ATOMIC_ARM32_H_
  34 #define _RTE_ATOMIC_ARM32_H_
  35
  36 #ifndef RTE_FORCE_INTRINSICS
  37 #  error Platform must be built with CONFIG_RTE_FORCE_INTRINSICS
  38 #endif
  39
  40 #ifdef __cplusplus
  41 extern "C" {
  42 #endif
  43
  44 #include "generic/rte_atomic.h"
  45
  46 /**
  47  * General memory barrier.
  48  *
  49  * Guarantees that the LOAD and STORE operations generated before the
  50  * barrier occur before the LOAD and STORE operations generated after.
  51  */
  52 #define rte_mb()  __sync_synchronize()
  53
  54 /**
  55  * Write memory barrier.
  56  *
  57  * Guarantees that the STORE operations generated before the barrier
  58  * occur before the STORE operations generated after.
  59  */
  60 #define rte_wmb() do { asm volatile ("dmb st" : : : "memory"); } while (0)
  61
  62 /**
  63  * Read memory barrier.
  64  *
  65  * Guarantees that the LOAD operations generated before the barrier
  66  * occur before the LOAD operations generated after.
  67  */
  68 #define rte_rmb() __sync_synchronize()
  69
  70 #define rte_smp_mb() rte_mb()
  71
  72 #define rte_smp_wmb() rte_wmb()
  73
  74 #define rte_smp_rmb() rte_rmb()
  75
  76 #define rte_io_mb() rte_mb()
  77
  78 #define rte_io_wmb() rte_wmb()
  79
  80 #define rte_io_rmb() rte_rmb()
  81
  82 #define rte_cio_wmb() rte_wmb()
  83
  84 #define rte_cio_rmb() rte_rmb()
  85
  86 #ifdef __cplusplus
  87 }
  88 #endif
  89
  90 #endif /* _RTE_ATOMIC_ARM32_H_ */