lib/librte_eal/common/include/arch/arm/rte_atomic_64.h

   1 /*
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  30  *   OF THIS SOFTWARE, EVEN IF ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.
  31 */
  32
  33 #ifndef _RTE_ATOMIC_ARM64_H_
  34 #define _RTE_ATOMIC_ARM64_H_
  35
  36 #ifndef RTE_FORCE_INTRINSICS
  37 #  error Platform must be built with CONFIG_RTE_FORCE_INTRINSICS
  38 #endif
  39
  40 #ifdef __cplusplus
  41 extern "C" {
  42 #endif
  43
  44 #include "generic/rte_atomic.h"
  45
  46 #define dmb(opt)  do { asm volatile("dmb " #opt : : : "memory"); } while (0)
  47
  48 /**
  49  * General memory barrier.
  50  *
  51  * Guarantees that the LOAD and STORE operations generated before the
  52  * barrier occur before the LOAD and STORE operations generated after.
  53  * This function is architecture dependent.
  54  */
  55 static inline void rte_mb(void)
  56 {
  57         dmb(ish);
  58 }
  59
  60 /**
  61  * Write memory barrier.
  62  *
  63  * Guarantees that the STORE operations generated before the barrier
  64  * occur before the STORE operations generated after.
  65  * This function is architecture dependent.
  66  */
  67 static inline void rte_wmb(void)
  68 {
  69         dmb(ishst);
  70 }
  71
  72 /**
  73  * Read memory barrier.
  74  *
  75  * Guarantees that the LOAD operations generated before the barrier
  76  * occur before the LOAD operations generated after.
  77  * This function is architecture dependent.
  78  */
  79 static inline void rte_rmb(void)
  80 {
  81         dmb(ishld);
  82 }
  83
  84 #ifdef __cplusplus
  85 }
  86 #endif
  87
  88 #endif /* _RTE_ATOMIC_ARM64_H_ */